В форуме 670 тем

1.  
   Название темы
   Автор
   Статистика
   Последнее сообщение
2.  

   SystemVerilog [RTL] & ASIC Design Flow

   • 1
   • 2

   Doka
   • 23 ответа
   • 8 487 просмотров
   • Вчера в 06:52
   • Посл. сообщение: lexx
3.  

   Чудесное превращение ПЛИС в Asic

   • 1
   • 2
   • 3

   influenza
   • 32 ответа
   • 11 852 просмотра
   • воскресенье в 17:41
   • Посл. сообщение: baumanets
4.  

   Перехарактеризация liberty библиотек

   kenaken
   • 1 ответ
   • 72 просмотра
   • 7 ноября
   • Посл. сообщение: Aleх
5.  

   [полу]авто-ClockGating в ASIC

   Doka
   • 6 ответов
   • 3 041 просмотр
   • 4 ноября
   • Посл. сообщение: topor_topor
6.  

   CADENCE vs SYNOPSYS

   Mikhail241
   • 5 ответов
   • 3 695 просмотров
   • 4 ноября
   • Посл. сообщение: topor_topor
7.  

   Кремниевые заводы

   • 1
   • 2
   • 3
   • 4
   • 13

   reges
   • 184 ответа
   • 36 562 просмотра
   • 2 ноября
   • Посл. сообщение: baumanets
8.  

   Бывает ли IBIS осциллографа?

   flammmable
   • 1 ответ
   • 80 просмотров
   • 30 октября
   • Посл. сообщение: falling_stone
9.  

   характеризация в liberate

   Mikhail241
   • 9 ответов
   • 4 167 просмотров
   • 8 октября
   • Посл. сообщение: kenaken
10.  

    Модель паразитного pnp на подложку в npn транзисторе

    TiNat
    • 2 ответа
    • 1 484 просмотра
    • 7 сентября
    • Посл. сообщение: TiNat
11.  

    генерация IBIS-моделей в Cadence Sigrity (T2B)

    vermut.42
    • 3 ответа
    • 1 435 просмотров
    • 27 августа
    • Посл. сообщение: vermut.42
12.  

    Кто у нас в России занимается производством п/п структур А2B6 и приборов на их основе?

    baumanets
    • 3 ответа
    • 1 391 просмотр
    • 19 августа
    • Посл. сообщение: alexunder
13.  

    документация Synopsys Design Compiler

    demidrol
    • 6 ответов
    • 3 198 просмотров
    • 16 августа
    • Посл. сообщение: designer78
14.  

    Умножитель для библиотеки SILTERRA18SG

    Suicide
    • 6 ответов
    • 2 631 просмотр
    • 28 июля
    • Посл. сообщение: Fat Robot
15.  

    Поиск библиотек для 45 и 65 нм

    • 1
    • 2

    yurypus
    • 21 ответ
    • 8 040 просмотров
    • 9 июля
    • Посл. сообщение: Блондин
16.  

    ПО для обратной разработки интегральных схем

    jimbo)
    • 12 ответов
    • 3 018 просмотров
    • 27 июня
    • Посл. сообщение: a123-flex
17.  

    Глупый вопрос про Setup and Hold

    p.socrat
    • 11 ответов
    • 2 937 просмотров
    • 29 мая
    • Посл. сообщение: baumanets
18.  

    Выравнивание производительности FPGA и ASIC на функциях хэширования

    jojo
    • 14 ответов
    • 3 204 просмотра
    • 10 мая
    • Посл. сообщение: jojo
19.  

    реализация подхода DVFS в тулах Cadence

    Doka
    • 0 ответов
    • 2 900 просмотров
    • 23 марта
    • Посл. сообщение: Doka
20.  

    структура CAN трансивера

    another_one
    • 7 ответов
    • 3 308 просмотров
    • 22 февраля
    • Посл. сообщение: another_one
21.  

    Ищу репетитора по маршруту проектирования RTL-to-GDSII

    • 1
    • 2

    baumanets
    • 25 ответов
    • 6 577 просмотров
    • 14 февраля
    • Посл. сообщение: vermut.42
22.  

    Зависимость между Silicon Revision чипа и размером Erratasheet

    Baser
    • 2 ответа
    • 3 454 просмотра
    • 9 января
    • Посл. сообщение: Kabdim
23.  

    скрыть "Background IP" при передаче к 3rd party

    Димыч
    • 7 ответов
    • 3 827 просмотров
    • 28 декабря, 2017
    • Посл. сообщение: Димыч
24.  

    Training Cadence tools

    • 1
    • 2

    grigorik
    • 26 ответов
    • 7 190 просмотров
    • 8 декабря, 2017
    • Посл. сообщение: samsalexandr
25.  

    какой пакет нужен для поддержки Verilog-AMS?

    yes
    • 5 ответов
    • 3 673 просмотра
    • 29 ноября, 2017
    • Посл. сообщение: designer78
26.  

    ПРОБЛЕМЫ СИНТЕЗА ТАКТОВОГО ДЕРЕВА

    Mikhail241
    • 11 ответов
    • 3 984 просмотра
    • 17 ноября, 2017
    • Посл. сообщение: kaiser125