Quartus II не учитывает инерционные задержки, которые я указываю в VHDL описании. Для примера сделал простейший проект.
Подскажите пожалуйста где ошибка, в синтаксисе или настройках квартуса?
entity test is
port(a1,a2: in bit;
outp: out bit);
end test;
architecture bloc of test is
begin
process (a1,a2)
begin
outp<= a1 and a2 after 15 ns ; --инерционная задержка в 15 ns не учитывается
end process;
end bloc;