Костян 0 19 апреля, 2011 Опубликовано 19 апреля, 2011 · Жалоба Итак дано: wire [15:0] CODE; assign CODE = 16'b1110011010000101; //----------------------------------------------------------- //% gate //----------------------------------------------------------- genvar j; generate for (j = 0; j < (16); j = j + 1) begin: genj gate_bit #(.L(CODE[15-j]),.D(D)) gate_bit_mod ( .rst(rst), .clk(clk), ..... ); end endgenerate Синплифай кушает буд здоров. Modelsim же ругается на wire CODE: Module instance parameter must be constant. Как параметризировать, чтобы modelsim тоже скушал? Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
masics 0 19 апреля, 2011 Опубликовано 19 апреля, 2011 · Жалоба написать: parameter CODE = 16'b1110011010000101; или localparam CODE = 16'b1110011010000101; Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
Костян 0 19 апреля, 2011 Опубликовано 19 апреля, 2011 · Жалоба написал parameter моделсим скушал, но синплифай для всех gate_bit сделал L=1 Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
bogaev_roman 0 19 апреля, 2011 Опубликовано 19 апреля, 2011 · Жалоба написал parameter моделсим скушал, но синплифай для всех gate_bit сделал L=1 Сделайте тогда reg [15:0] CODE = 16'b1110011010000101 Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
CaPpuCcino 0 19 апреля, 2011 Опубликовано 19 апреля, 2011 · Жалоба Сделайте тогда reg [15:0] CODE = 16'b1110011010000101 ток параметр впереди не забудьте, потому что это переменная времени компиляции Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
Костян 0 19 апреля, 2011 Опубликовано 19 апреля, 2011 · Жалоба спасибо. заработало. Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться