RoadRunner 0 30 августа, 2019 Опубликовано 30 августа, 2019 (изменено) · Жалоба Всем доброго времени суток. Задача такая: надо частоту avalon-MM интерфейса контроллера памяти установить в районе 100 Мгц (плюс/минус 10Мгц). Т.е. это частота, с которой логикой планирую писать и читать туда. Проблема в том, что на ките с которым в данный момент работаю (CYclone 10 GX Development Kit), частота входного для памяти клока pll_ref_clk = 21,186 МГц (другие клоки не подключишь - Квартус ругается). При этой входной частоте большой получается частота работы чипа памяти (932 МГц) и как следствие генерируемая частота для тактирования логики emif_user_clk = 932/4 = 233 МГц. Понизить бы ее как-нибудь до 100 МГц. Такая скорость работы чипа мне тоже ни к чему. В предыдущей версии мегафункции DDR3 контроллера был отдельный тактирующий вход для avalon-MM интерфейса. Можно было emif_user_clk понизить на сколько хочешь через внешнюю PLL, завести на этот вход и всю приходящую на него логику. В версии 19.2 такого тактирующего входа у avalon-MM интерфейса я пока не нашел. Т.е. получается, что avalon-MM тактируется напрямую emif_user_clk и это не изменить, а стало быть и приходящая на него логика тоже должна им же тактироваться. И частоту эту ни понизить, ни повысить. Или я что-то неправильно понимаю и есть какие-то возможности? Подскажите, кто знает. Спасибо. Изменено 30 августа, 2019 пользователем RoadRunner Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
gosu-art 0 30 августа, 2019 Опубликовано 30 августа, 2019 · Жалоба Вам нужен Avalon-MM Clock Crossing bridge. Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться