zombi 0 11 мая, 2018 Опубликовано 11 мая, 2018 · Жалоба У DDR памяти есть сигналы DQS,LDQS,UDQS,RDQS. Все они, судя по описанию, являются выходами при чтении из памяти и соотв. входами при записи. И при чтении, как я понял, фронты выровнены по краям самого первого меняющегося сигнала на шине данных DQ. А при записи должны быть выровнены по центру. Зачем так сделано? Каким образом стробировать данные при чтении из DDR? Цитата из DS: DQS, DQS# I/O Data strobe: Output with read data, input with write data for source synchronous operation. Edge-aligned with read data, center-aligned with write data. Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
dii# 0 12 мая, 2018 Опубликовано 12 мая, 2018 · Жалоба Могу предположить, что так делают, потому, что обязанность определять моменты времени установления достоверных сигналов на DQ лежит всегда на тактирующей стороне. Микросхема памяти выставляет строб одновременно с данными, а контроллер сам выбирает момент времени регистрации данных, причем, вероятно, с частичным использованием тех же своих внутренних цепей, что и при выдаче стробов на запись в память. Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
zombi 0 12 мая, 2018 Опубликовано 12 мая, 2018 · Жалоба а контроллер сам выбирает момент времени регистрации данных Ну если так, то могу ли я захватывать DQ не смещённым (задержанным) фронтом DQS, а просто сигналом CK сдвинутым на 90 град? Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
dii# 0 12 мая, 2018 Опубликовано 12 мая, 2018 · Жалоба ну, если нет оснований предполагать, что DQ и DQS от памяти могут опаздывать, то да, выходит. Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться
zombi 0 13 мая, 2018 Опубликовано 13 мая, 2018 · Жалоба Ага, вроде разобрался. А может и ошибаюсь. Подскажите знатоки правильно ли я понял: Есть у DDR параметр Tdqsq. Это время через которое после фронта DQS заканчивается последний действительный переход DQ. И судя по DS, на мою мс памяти, он не более 0.35 нс. Получается нужно фронт сигнал DQS задержать на не менее чем 350 ps. Как осуществить такую задержку сигнала, например на fpga MAX10? Цитата Поделиться сообщением Ссылка на сообщение Поделиться на другие сайты Поделиться