Устройство приема и декодирования IrDA

Ответить

17 июня, 2017

Всем привет!

Сейчас проектирую приемник и декодер для IrDA. По ТЗ выходной сигнал должен быть с ТТЛ уровнями.

Нужно схемотехнически отрезать старт и стоп бит после триггера Шмитта.

Пока есть такая схема, но не получается её смоделировать. (Проблема с использованием ФАПЧ).

Присоединяйтесь к обсуждению

Вы можете написать сейчас и зарегистрироваться позже. Если у вас есть аккаунт, авторизуйтесь, чтобы опубликовать от имени своего аккаунта.

Ответить в этой теме...

× Вставлено с форматированием. Вставить как обычный текст

Разрешено использовать не более 75 эмодзи.

× Ваша ссылка была автоматически встроена. Отображать как обычную ссылку

× Ваш предыдущий контент был восстановлен. Очистить редактор

× Вы не можете вставлять изображения напрямую. Загружайте или вставляйте изображения по ссылке.