Jump to content

    

ilya79

Свой
  • Content Count

    177
  • Joined

  • Last visited

Community Reputation

0 Обычный

About ilya79

  • Rank
    Частый гость

Контакты

  • ICQ
    Array

Recent Profile Visitors

4517 profile views
  1. Добрый день! Требуется разработать усилитель мощности (Pвых~8 Вт) на диапазон 4400-4800 МГц. Уровень входного сигнала 0 dBm. Желательно использовать TIM4450-8UL(FLM4450-8F) или аналогичный GaAs, в качестве предусилителя что-то вроде sza-5044. Система с временным разделением, необходимо предусмотреть коммутацию прием/передача. Предложения просьба писать в личку.
  2. Требуется FPGA - разработчик Место работы: г. Москва, НИЧ МТУСИ м. Авиамоторная 8. Из обязательных требований: 1. Verilog или SystemVerilog. Желательно (но не обязательно) : 1. C/C++. 2. MatLab. 3. Опыт реализации ЦОС на ПЛИС. 4. Опыт работы с PCIE. 5. Опыт написания несложных приложений для взаимодействия с аппаратной частью (через переходники usb<->uart). Характер выполняемой работы: 1. Разработка систем цифровой обработки на ПЛИС (фильтры, демодуляторы, декодеры LDPC, декодеры турбо-кодов). 2. Работа с интерфейсами PCIE, Ethernet. 3. Работа с Zynq Ultrascale+. 4. Работа с AD9371/AD9361. Варианты удаленной работы не рассматриваются, только полная занятость. Рассматриваются кандидаты и без опыта работы с ПЛИС. Зарплата от 70 тыс. руб. на руки без опыта, от 100 т.р. и выше при наличии. Испытательный срок 3-месяца. Для связи- golovkin@srd.mtuci.ru
  3. Спасибо всем откликнувшимся! Разработчик найден. Вакансия закрыта.
  4. des333 сделал абсолютно справедливые замечания. Поднимать что-то за 3 месяца не нужно. Не разумно ставить нового человека в проект который скоро сдавать. Испытательный срок нужен чтобы понять что человек реально может (на деле, а не на словах). Критическую и сложную задачу в проекте естественно новому человеку никто не даст.
  5. Да. Обратите внимание что это- "Характер выполняемой работы:". Требования к кандидату минимальные+"Рассматриваются кандидаты и без опыта работы с ПЛИС". Фактически выпускник ВУЗа без опыта работы. Т.е. есть возможность научиться делать "фильтры, демодуляторы, декодеры LDPC, декодеры турбо-кодов,PCIE, Ethernet" получая при этом зарплату от 60 т.р.
  6. Требуется FPGA - разработчик Место работы: г. Москва, МТУСИ м. Авиамоторная Из обязательных требований: 1. Verilog или SystemVerilog. Желательно : 1. C/C++. 2. MatLab. 3. Опыт реализации ЦОС на ПЛИС. 4. Опыт работы с PCIE. 5. Опыт написания несложных приложений для взаимодействия с аппаратной частью (через переходники usb<->uart). Характер выполняемой работы: 1. Разработка систем цифровой обработки на ПЛИС (фильтры, демодуляторы, декодеры LDPC, декодеры турбо-кодов). 2. Работа с интерфейсами PCIE, Ethernet. Варианты удаленной работы не рассматриваются, только полная занятость. Рассматриваются кандидаты и без опыта работы с ПЛИС. Зарплата от 60 до 100 тыс. руб. на руки (в зависимости от опыта). Испытательный срок 3-месяца. Для связи- golovkin@srd.mtuci.ru
  7. Требуется FPGA - разработчик Место работы: г. Москва, МТУСИ м. Авиамоторная Из обязательных требований: 1. Verilog или SystemVerilog. Желательно : 1. C/C++. 2. MatLab. 3. Опыт реализации ЦОС на ПЛИС. 4. Опыт работы с PCIE. 5. Опыт написания несложных приложений для взаимодействия с аппаратной частью (через переходники usb<->uart). Характер выполняемой работы: 1. Разработка систем цифровой обработки на ПЛИС (фильтры, демодуляторы, декодеры LDPC, декодеры турбо-кодов). 2. Работа с интерфейсами PCIE, Ethernet. Варианты удаленной работы не рассматриваются, только полная занятость. Рассматриваются кандидаты и без опыта работы с ПЛИС. Зарплата от 60 до 100 тыс. руб. на руки (в зависимости от опыта). Испытательный срок 3-месяца. Для связи- golovkin@srd.mtuci.ru
  8. Если подозрение на Vivado то Flood правильно вам предложил проверить модель после синтеза. Если там все ок то у вас либо времянка не проходит либо проблемы с аппаратной частью или тактами.
  9. Интересно было бы в Chipscope вывести и сигналы serv_val_line(всю шину, она похоже в srl при вашем описании не map-ится) и ireset и iclken. Вы пытаетесь размножить сигнал ival на 4 такта? Ну или я не правильно понял что не так работает.
  10. А вам точно нужен асинхронный сброс? Тут в конце https://forums.xilinx.com/t5/7-Series-FPGAs...set/td-p/473746 есть рекомендация по асинхронному сбросу
  11. Без модели нелинейного усилителя и оценки TD (Total Degradation)= потери Eb/N0+потерии OBO, наверное не корректный вывод. Посмотрите тут http://jwcn.eurasipjournals.springeropen.c...7-1499-2012-317 Выигрыш APSK-16 относительно QAM-16 ~ (2дБ-0.6дБ)=1.4 при OBO 3 дБ (рис. 7 в статье) . Вы учитываете что оптимальное отношение радиусов колец для APSK разное для разных кодовых скоростей? В статье цифры для некодированой передачи. Применение хорошего кода снизит разницу до 0.6-0.7 дБ .
  12. glbl: Если это базовый код для C2 в CCSDS, то в CCSDS 131.1-O-2 в приложении A есть матрица генератор.
  13. Если SDR на Zedboard делать, AD-FMCOMMS1-EBZ вам не подойдет ?
  14. Если выход канала неквантованный то это BI-AWGN capacity. Lin Costello Error control coding 2nd edition стр. 20 . Саму книгу можно найти через libgen info.